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Design of Low Power Adder Using Double Gate & MTCMOS Technology 3789 - Bild 1 von 1

Design of Low Power Adder Using Double Gate & MTCMOS Technology von Priyanka K (2017, Taschenbuch)

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Other than reducing leakage power the MTCMOS technique could be used for a different design goal. This leads to even reduction in power since MTCMOS technique is used. These cells can be designed by varying the size of the sleep transistor to handle different loads and this can be used for minimum area, high speed applications.